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PCIe接口的PCB布局布線要求

2023/08/14
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PCI-Express,簡稱“PCI-e”是一種高速串行計(jì)算機(jī)擴(kuò)展總線標(biāo)準(zhǔn),PCI-E屬于高速串行點(diǎn)對點(diǎn)雙通道高帶寬傳輸,所連接的設(shè)備分配獨(dú)享通道帶寬,不共享總線帶寬,它的主要優(yōu)勢就是數(shù)據(jù)傳輸速率高。

PCI-E2.0和PCI-E3.0主要存在以下不同:

1)最大數(shù)據(jù)率不同:PCI-E 2.0只能提供5GT/S的最大數(shù)據(jù)率,而PCI-E 3.0的數(shù)據(jù)傳輸率則達(dá)到了8GT/S,提高了總線帶寬。PCI-E 3.0規(guī)范將數(shù)據(jù)傳輸率提升到8GT/S,并且保持了對PCI-E 2.x/1.x的向下兼容,繼續(xù)支持2.5T/S、5T/S信號機(jī)制。

2)編碼方式不同:PCI Express 3.0工作在8T/S頻率上,取消了傳統(tǒng)的8b/10b編碼,它將引入包括信號強(qiáng)化(enhanced signaling)、數(shù)據(jù)完整性(data integrity)、傳輸接收均衡、PLL改善、時(shí)脈數(shù)據(jù)恢復(fù)和通用擴(kuò)展等多項(xiàng)技術(shù)。

針對PCI-E2.0和PCI-E3.0的不同特點(diǎn),對應(yīng)也有不同的PCB設(shè)計(jì)要求。

PCI-E接口的PCB設(shè)計(jì)有如下表1所示注意事項(xiàng):

表1 PCI-E接口的PCB設(shè)計(jì)要求

建議在 BGA 區(qū)域的以下位置加地通孔,并建議差分信號作包地處理,包地線的地孔間隔小于300mil。如圖1所示。

圖1 PCIe3.0 BGA 區(qū)域扇出走線

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