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  • 正文
    • 1. 工程文件
    • 2. 原理圖文件
    • 3. 程序代碼
    • 4. UCF文件
    • 5. 工程編譯
    • 6. Testbench
    • 7. 仿真圖
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60進(jìn)制遞減計(jì)數(shù)器設(shè)計(jì)Verilog代碼ISE仿真

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名稱：60進(jìn)制遞減計(jì)數(shù)器設(shè)計(jì)Verilog代碼ISE仿真

軟件：ISE

語言：Verilog

代碼功能：

60進(jìn)制遞減計(jì)數(shù)器

使用開關(guān)控制計(jì)數(shù)器的功能，當(dāng)開關(guān)為1時(shí)，預(yù)置初始值為59，開關(guān)為0時(shí)按時(shí)鐘遞減1，減到0回59

1. 工程文件

2. 原理圖文件

3. 程序代碼

4. UCF文件

5. 工程編譯

 

6. Testbench

7. 仿真圖

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